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Campo DC Valor Lengua/Idioma
dc.contributor.advisorNatividade da Silva Barros, Edna pt_BR
dc.contributor.authorPyetro Amaral Ferreira, Antonyuspt_BR
dc.date.accessioned2014-06-12T15:59:56Z-
dc.date.available2014-06-12T15:59:56Z-
dc.date.issued2011-01-31pt_BR
dc.identifier.citationPyetro Amaral Ferreira, Antonyus; Natividade da Silva Barros, Edna. Desenvolvimento de uma arquitetura paralela para redes neurais artificiais MLP baseada em FPGAS. 2011. Dissertação (Mestrado). Programa de Pós-Graduação em Ciência da Computação, Universidade Federal de Pernambuco, Recife, 2011.pt_BR
dc.identifier.urihttps://repositorio.ufpe.br/handle/123456789/2653-
dc.description.abstractEste trabalho apresenta a definição de uma arquitetura, baseada em FPGA, para implementação de Redes Neurais (RNAs) MLP. A arquitetura proposta foi projetada observando-se critérios limitantes como grande quantidade de entradas, redução do consumo de área, utilização de pinos, recursos de interconexão e compromisso entre área/desempenho. Um importante resultado é a utilização de log2m adicionadores para uma RNA com m entradas. Uma RNA cuja topologia é 256:10:10 atingiu um speed-up de 36x, comparado com uma implementação convencional em C rodado em um PC. Uma ferramenta de geração automática do código da RNA em linguagem HDL também foi desenvolvidapt_BR
dc.language.isoporpt_BR
dc.publisherUniversidade Federal de Pernambucopt_BR
dc.rightsopenAccesspt_BR
dc.rightsAttribution-NonCommercial-NoDerivs 3.0 Brazil*
dc.rights.urihttp://creativecommons.org/licenses/by-nc-nd/3.0/br/*
dc.subjectInteligência Artificialpt_BR
dc.subjectRedes Neuraispt_BR
dc.subjectArquitetura de computadorpt_BR
dc.subjectFPGApt_BR
dc.titleDesenvolvimento de uma arquitetura paralela para redes neurais artificiais MLP baseada em FPGASpt_BR
dc.typemasterThesispt_BR
Aparece en las colecciones: Dissertações de Mestrado - Ciência da Computação

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